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XC2C256 IC XC2C2566CP132C CPLD CoolRunner-II 256MC

CPLD - Complex Programmable Logic Devices 132-CSPBGA 8x8

XC2C256 - Xilinx
XC2C256 IC XC2C2566CP132C CPLD CoolRunner-II 256MC
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R$ 99,00

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ou R$ 110,00 no cartão em até 10x sem juros (apenas na loja física)

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Garantia:
7 dias troca. Sem garantia após soldado

NCM:
85423190

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Novo em embalagem antiestática

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XC2C256 IC XC2C2566CP132C CPLD CoolRunner-II 256MC
CPLD - Complex Programmable Logic Devices 132-CSPBGA 8x8

Condição de XC2C256:    Novo em embalagem antiestática

Garantia  de  XC2C256:     7 dias troca. Sem garantia após soldado

Outros PNs para este item:     2C256, XC2C256-6CP132C



O XC2C2566CP132C é um  CPLD da família CoolRunner II com 6K portas, 256 macrocélulas, tecnologia CMOS de 0,18 m, 1,8 V e encapsulamento CSBGA de 132 pinos.
BGA CP de 132 pinos (0,5 mm) com 106 pinos de E/S para o usuário.
 
O dispositivo CoolRunnerII 256macrocell foi projetado para aplicações de alto desempenho e baixo consumo de energia. Isso proporciona economia de energia para equipamentos de comunicação de ponta e alta velocidade para dispositivos alimentados por bateria. Devido ao baixo consumo em modo de espera e à operação dinâmica, a confiabilidade geral do sistema é aprimorada.
 
Este dispositivo consiste em dezesseis Blocos de Função interconectados por uma Matriz de Interconexão Avançada (AIM) de baixo consumo de energia. A AIM fornece 40 entradas verdadeiras e complementares para cada Bloco de Função. Os Blocos de Função consistem em um PLA Pterm de 40 por 56 e 16 macrocélulas que contêm inúmeros bits de configuração que permitem modos de operação combinacionais ou registrados.
 
Além disso, esses registradores podem ser reinicializados ou predefinidos globalmente e configurados como flip-flops D ou T ou como latch D. Há também múltiplos sinais de clock, tanto globais quanto locais, configurados individualmente para cada macrocélula. As configurações dos pinos de saída incluem limitação da taxa de variação (slew rate), retenção de barramento (bus hold), pull-up, dreno aberto e terras programáveis. Uma entrada Schmittrigger está disponível individualmente para cada pino de entrada. Além de armazenar os estados de saída das macrocélulas, os registradores das macrocélulas podem ser configurados como registradores de entrada direta para armazenar sinais diretamente dos pinos de entrada.
 
O controle de clock está disponível globalmente ou por bloco de função. Três clocks globais estão disponíveis para todos os blocos de função como fonte de clock síncrona. Os registradores da macrocélula podem ser configurados individualmente para inicializar no estado zero ou um. Uma linha de controle global de set/reset também está disponível para definir ou redefinir registradores selecionados de forma assíncrona durante a operação. Sinais adicionais de clock local, habilitação de clock síncrono, set/reset assíncrono e habilitação de saída podem ser criados usando termos de produto por macrocélula ou por bloco de função.
 
Um recurso de flip-flop DualEDGE também está disponível por macrocélula. Esse recurso permite uma operação síncrona de alto desempenho baseada em clock de frequência mais baixa, ajudando a reduzir o consumo total de energia do dispositivo.
Também foi incluído um circuito para dividir um sinal de clock global fornecido externamente (GCK2) por oito seleções diferentes. Isso resulta na divisão por frequências de clock pares e ímpares.
A utilização do divisor de clock (divisão por 2) e do flip-flop DualEDGE resulta na funcionalidade CoolCLOCK.
DataGATE é um método para desativar seletivamente as entradas do CPLD que não são de interesse durante determinados momentos.
 
Fabricante: Xilinx
Categoria do produto: CPLD (Dispositivos Lógicos Programáveis Complexos)
Série: XC2C256
Estilo de montagem: SMD/SMT
Pacote/Invólucro: CSBGA132
Tensão de alimentação operacional: 1,8 V
Número de macrocélulas: 256
Número de E/S: 106
Tensão máxima de alimentação de E/S: 1,9 V
Tensão mínima de alimentação: 1,7 V
Temperatura mínima de operação: 0 C
Temperatura máxima de operação: 70 C
Frequência máxima de operação: 256 MHz
Atraso máximo de propagação: 5,7 ns
Marca: Xilinx
Número de blocos de matriz lógica (LABs): 16
Corrente de alimentação operacional: 21 A
Tipo de produto: CPLD (Dispositivos Lógicos Programáveis Complexos)
Subcategoria: CIs Lógicos Programáveis


Maiores detalhes de XC2C256 no site do fabricante:
https://www.xilinx-adm.com/files/69/102990004.pdf


Tags de XC2C256: XC2C2566CP132C, microcontrolador MCU, MCU FPGA, 2C256, XC2C256, XC2C256-6CP132C, XC2C256-7VQG100C, XC2C256-7TQG144C, XC2C256-6CPG132C, XC2C256-7CPG132C, XC2C256-7CP132C, CPLD - Complex Programmable Logic Devices, CPLD CoolRunner II Familym XC2C256 CoolRunner-II CPLD, Xilinx

XC2C256 IC XC2C2566CP132C CPLD CoolRunner-II 256MC CPLD - Complex Programmable Logic Devices 132-CSPBGA 8x8

Condição de XC2C256:
Novo em embalagem antiestática

Garantia  de  XC2C256:
7 dias troca. Sem garantia após soldado

Outros PNs para este componente:     2C256, XC2C256-6CP132C


O XC2C2566CP132C é um  CPLD da família CoolRunner II com 6K portas, 256 macrocélulas, tecnologia CMOS de 0,18 m, 1,8 V e encapsulamento CSBGA de 132 pinos.
BGA CP de 132 pinos (0,5 mm) com 106 pinos de E/S para o usuário.
 
O dispositivo CoolRunnerII 256macrocell foi projetado para aplicações de alto desempenho e baixo consumo de energia. Isso proporciona economia de energia para equipamentos de comunicação de ponta e alta velocidade para dispositivos alimentados por bateria. Devido ao baixo consumo em modo de espera e à operação dinâmica, a confiabilidade geral do sistema é aprimorada.
 
Este dispositivo consiste em dezesseis Blocos de Função interconectados por uma Matriz de Interconexão Avançada (AIM) de baixo consumo de energia. A AIM fornece 40 entradas verdadeiras e complementares para cada Bloco de Função. Os Blocos de Função consistem em um PLA Pterm de 40 por 56 e 16 macrocélulas que contêm inúmeros bits de configuração que permitem modos de operação combinacionais ou registrados.
 
Além disso, esses registradores podem ser reinicializados ou predefinidos globalmente e configurados como flip-flops D ou T ou como latch D. Há também múltiplos sinais de clock, tanto globais quanto locais, configurados individualmente para cada macrocélula. As configurações dos pinos de saída incluem limitação da taxa de variação (slew rate), retenção de barramento (bus hold), pull-up, dreno aberto e terras programáveis. Uma entrada Schmittrigger está disponível individualmente para cada pino de entrada. Além de armazenar os estados de saída das macrocélulas, os registradores das macrocélulas podem ser configurados como registradores de entrada direta para armazenar sinais diretamente dos pinos de entrada.
 
O controle de clock está disponível globalmente ou por bloco de função. Três clocks globais estão disponíveis para todos os blocos de função como fonte de clock síncrona. Os registradores da macrocélula podem ser configurados individualmente para inicializar no estado zero ou um. Uma linha de controle global de set/reset também está disponível para definir ou redefinir registradores selecionados de forma assíncrona durante a operação. Sinais adicionais de clock local, habilitação de clock síncrono, set/reset assíncrono e habilitação de saída podem ser criados usando termos de produto por macrocélula ou por bloco de função.
 
Um recurso de flip-flop DualEDGE também está disponível por macrocélula. Esse recurso permite uma operação síncrona de alto desempenho baseada em clock de frequência mais baixa, ajudando a reduzir o consumo total de energia do dispositivo.
Também foi incluído um circuito para dividir um sinal de clock global fornecido externamente (GCK2) por oito seleções diferentes. Isso resulta na divisão por frequências de clock pares e ímpares.
A utilização do divisor de clock (divisão por 2) e do flip-flop DualEDGE resulta na funcionalidade CoolCLOCK.
DataGATE é um método para desativar seletivamente as entradas do CPLD que não são de interesse durante determinados momentos.
 
Fabricante: Xilinx
Categoria do produto: CPLD (Dispositivos Lógicos Programáveis Complexos)
Série: XC2C256
Estilo de montagem: SMD/SMT
Pacote/Invólucro: CSBGA132
Tensão de alimentação operacional: 1,8 V
Número de macrocélulas: 256
Número de E/S: 106
Tensão máxima de alimentação de E/S: 1,9 V
Tensão mínima de alimentação: 1,7 V
Temperatura mínima de operação: 0 C
Temperatura máxima de operação: 70 C
Frequência máxima de operação: 256 MHz
Atraso máximo de propagação: 5,7 ns
Marca: Xilinx
Número de blocos de matriz lógica (LABs): 16
Corrente de alimentação operacional: 21 A
Tipo de produto: CPLD (Dispositivos Lógicos Programáveis Complexos)
Subcategoria: CIs Lógicos Programáveis


Maiores detalhes de XC2C256 no site do fabricante:
https://www.xilinx-adm.com/files/69/102990004.pdf


Tags de XC2C256: XC2C2566CP132C, microcontrolador MCU, MCU FPGA, 2C256, XC2C256, XC2C256-6CP132C, XC2C256-7VQG100C, XC2C256-7TQG144C, XC2C256-6CPG132C, XC2C256-7CPG132C, XC2C256-7CP132C, CPLD - Complex Programmable Logic Devices, CPLD CoolRunner II Familym XC2C256 CoolRunner-II CPLD, Xilinx

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